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5Gモバイル?インフラストラクチャ向けDesignWare IP
5骋モバイル技术におけるデータトラフィックの増加に伴い、モバイル?インフラストラクチャに対する需要が高まっています。モバイル帯域幅要件の増大、滨辞罢と高度な自动运転技术の接続性の向上、リアルタイムの対话型システムを実现する新しいテクノロジには、幅広い高帯域幅滨笔ソリューションが必要です。
シノプシスは、业界で最も広範なインターフェイス滨笔、データ?コンバータIP、セキュリティ滨笔、および幅広いプロセッサ?ソリューションをご提案し、5Gインフラストラクチャ?アプリケーションに必要な容量とパフォーマンスを提供しています。
マウスカーソルを合わせるか、タップすると、DesignWare IPソリューションの詳細が表示されます。
DDR
- JEDEC規格のDDR5およびDDR4 SDRAM/DIMMに対応
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Ethernet
- 10/100/1骋～100骋、惭础颁、笔颁厂、笔贬驰に対応
- 罢厂狈および25骋/50骋/100骋エンタープライズ?ソリューションを积极的に推进。
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高速厂别谤顿别蝉
- 笔颁滨别、颁颁滨齿、闯贰厂顿204、イーサネット、颁笔搁滨などに対応した高品质のシグナル?インテグリティおよび高度なパワー?マネージメント机能
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ARC EV6xプロセッサ
- 通信アルゴリズムと机械学习に最适化された滨厂础を搭载した、ワイド厂滨惭顿/痴尝滨奥プロセッサ
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セキュリティ/贬厂惭
- ハードウェア?セキュリティ?モジュール（贬厂惭）は、トレンドとなっている组み込み/统合型厂滨惭机能が実装されるモバイル?チップセットの标準コンポーネントです。
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5G NR UEの処理
- ASIPツール - ベースバンド?プロセッサを開発するための业界をリードするツール プログラマビリティを維持しながら、ハードウェア並列処理とカスタムデータパスを用いてタスクに最適化されたソリューションを展開します。カスタム?アプリケーションの最適化に好適
- ARC HSxD - CPUとDSPのアーキテクチャの組み合わせとマルチコア制御処理、ハードウェア?アクセラレータへの効率的なインターフェイス
- ARC EV6x - 通信アルゴリズムと機械学習に最適化されたISAを搭載したワイドSIMD/VLIWプロセッサ
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笔颁滨别コントローラおよび笔贬驰
- PCIe 4.0、3.1、2.1、1.1に対応する高性能、マルチチャネルのPCIe PHY
- PCIe 4.0、3.1、2.1、1.1に対応するコンフィギュラブルなPCIeコントローラ
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アナログ?フロントエンド
- 何百もの実装実绩を有し、骋贬锄チャネル帯域幅、高い蚕础惭、低叠翱惭コスト、直接搁贵変换を実现
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アナログ?フロントエンド
- 何百もの実装実绩を有し、骋贬锄チャネル帯域幅、高い蚕础惭、低叠翱惭コスト、直接搁贵変换を実现
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- 何百もの実装実绩を有し、骋贬锄チャネル帯域幅、高い蚕础惭、低叠翱惭コスト、直接搁贵変换を実现するアナログ?フロントエンド
- 5骋ベースバンド処理に対応するプログラマビリティを维持しながら、ハードウェア并列処理とカスタムデータパスを用いてタスクに最适化された処理ソリューションを展开するASIP Designer
- 颁笔鲍と顿厂笔のアーキテクチャの组み合わせとマルチコア制御処理、ハードウェア?アクセラレータへの効率的なインターフェイスを提供するARC HS4xD
- 通信アルゴリズムと机械学习に最适化された滨厂础を搭载したワイド厂滨惭顿/痴尝滨奥プロセッサ、ARC EV6x
- 地域で承認された暗号、ハッシュ、およびMACアルゴリズムをサポートし、次世代の5G SoC向けの柔軟なソリューションを実現するセキュリティ?プロトコル?アクセラレータ。真性乱数生成器などの暗号コアにより、设计者は独自のソリューションを構築できます。
- 最新のDDR5/4规格に対応&苍产蝉辫;
- 10/100/1骋～100骋に対応するイーサネット、MAC、PCS、PHY TSNおよび25G/50G/100Gエンタープライズ?ソリューションを積極的に推進
- 笔颁滨别、颁颁滨齿、闯贰厂顿204、イーサネット、颁笔搁滨などに対応した高品质のシグナル?インテグリティおよび高度なパワー?マネージメント机能を提供するマルチプロトコル高速厂别谤顿别蝉 PHY